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12 DS565F2

CS5351

Figure 13. Master Mode, Left-Justified SAI Figure 14. Slave Mode, Left-Justified SAI

SCLK output

msl r

SDOUT

sdo

LRCK

output

MSB MSB-1

CLK input

LRCK input

dss

MSB MSB-1 MSB-2

sclkw

SDOUT

srdl

Figure 15. Master Mode, I²S SAI Figure 16. Slave Mode, I²S SAI

SCLK input

LRCK input

MSB

MSB-1

sclkw

SDOUT

srdl

dss

SCLK input

LRCK input

MSB

MSB-1

sclkw

SDOUT

srdl

dss

OVFL

setup

LRCK

hold

Figure 17. OVFL Output Timing

1 2 ... 7 8 9 10 11 12 13 14 15 16 17 ... 22 23

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